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数字设计与签核

Cadence® 数字与签核解决方案, 提供快速的设计收敛和更出色的可预测性,助您实现功耗、性能和面积(PPA)目标。

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定制 IC/模拟/ RF 设计

Cadence® 定制、模拟和射频设计解决方案可以实现模块级和混合信号仿真、布线和特征参数提取等诸多日常任务的自动化,助您节省大量时间。

PRODUCT CATEGORIES

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  • 电路仿真
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系统设计与验证

Cadence® Verification Suite中的系统设计和验证解决方案提供仿真、加速、模拟和验证管理功能。

PRODUCT CATEGORIES

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  • 硬件仿真加速器
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IP

开放的 IP 平台助您定制应用驱动的系统级芯片(SoC)设计。

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IC 封装设计与分析

提升先进封装、系统规划和多织构互操作性的效率和准确性,Cadence 封装实现工具可实现自动化和精准度。

PRODUCT CATEGORIES

  • IC 封装设计
  • IC封装设计流程
  • SI/PI 分析
  • SI/PI 分析点工具
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系统分析

Cadence®系统分析解决方案提供高精度的电磁提取和仿真分析,确保您的系统在广泛的运行条件下正常工作。

PRODUCT CATEGORIES

  • 射频/微波设计
  • 热求解器
  • 电磁求解器

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  • Clarity 3D Transient Solver
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PCB 设计与分析

Cadence® PCB 设计解决方案更好地结合了组件设计和约束驱动流程的系统级仿真,实现更短、更加可预测的设计周期。

PRODUCT CATEGORIES

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  • SI/PI 分析点工具
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Verification IP (VIP) Catalog

Industry de-facto standard VIP and memory models

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Key Benefits

  • Shorten simulation run time with optimized C-core VIP supporting all simulators, languages, and methodologies
  • Easy test writing with consistent and open UVM API and built-in coverage model, sequences, and error injection
  • No silicon escapes with the most accurate and comprehensive protocol and timing checks
  • Out-of-the-box comprehensive compliance verification suite for the latest protocols with  TripleCheck™

The Cadence® Verification IP (VIP) Catalog and memory models are optimized for the IP, SoC, and system-level testing required for today's designs. All Cadence VIP come with Pureview automated configuration and TripleCheck™ IP Validator compliance suite for complete verification coverage of your IP within the SoC. Cadence VIP runs seamlessly on our Xcelium™ simulator, Palladium™ Z1 emulation platforms, and any third-party simulator to speed up the verification process.

The Cadence VIP portfolio supports customers developing SoCs for automotive, hyperscale data center, and mobile applications.​

Cadence VIP Portfolio – One Stop Shop for all protocols and memories

AMBA

  • AMBA-AXI, APB, LPI, ATB
  • AMBA AHB
  • AMBA ACE
  • AMBA 5 CHI
  • AMBA 4 Stream
  • ARM SWD

PCIe® Express(PCIe®)

  • PCIe
  • PCIe SR-IOV
  • PCIe MR-IOV

Memory Models

  • DRAM
  • FLASH
  • Hybrid

USB

  • eUSB2
  • USB4
  • USB 3.2
  • USB Type-C

Ethernet

  • Ethernet 800G
  • Ethernet TSN
  • Ethernet Base-T

Display

  • DisplayPort 8K
  • DisplayPort 2.0
  • eDP
  • HDMI 2.0
  • DSC
  • CoaxPress

MIPI

  • MIPI CSI-2
  • MIPI DSI-2
  • MIPI SoundWire
  • MIPI UniPro
  • MIPI I3C
  • MIPI SLIMbus
  • D-PHY and C-PHY
  • MIPI RFFE
  • MIPI SPMI

Automotive

  • CAN
  • LIN
  • Ethernet TSN

Storage

  • SAS
  • SATA 6G
  • NVM Express

Subsystems

  • CCIX
  • CXL

Other VIPs:

  • OCP 3.0
  • PLB 6
  • SPI
  • JESD204B/C
  • TileLink
  • I2C
  • I2S
  • PMBus
  • SMBus
  • TileLink
  • JTAG
  • UART

See What Customers Have to Say About Cadence VIP

Click through to the next section for customer presentations.

  • NVMe Advanced Verification, Broadcom, CDNLive India 2019
  • Verification of GDDR6 High-Speed Memory PHY IP Using Cadence VIP, Rambus, CDNLive India 2019
  • Experiences with Deploying Cadence's PCIe VIP Solution in UVM-Based PCIe Controller Testbench, Nvidia, CDNLive India 2017
  • SoC Interconnect Verification Using Verification Workbench and IP-XACT Flow, Samsung, CDNLive India 2017
  • DisplayPort IP Verification Challenges and Solutions for Ultra High Resolutions (4K) and MST, Samsung, CDNLive India 2017
  • Streamline the Verification Flow and Apply to DisplayPort 8K4K Design, Samsung Semiconductor, CDNLive India 2017
Less [-] More [+]

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TRAINING COURSES

Keeping Dry in a Rain of New Protocols Using Cadence Verification IP

Rambus Verifies GDDR6 High-Speed Memory PHY IP Using Cadence VIP​

Production-Proven VIP from Cadence

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    • Perspec System Verifier
    • Xcelium Logic Simulation
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    • Assertion-Based VIP
    • Interconnect Automated Verification Solution
    • Perspec System Verifier
    • Memory Models
News ReleasesVIEW ALL
  • Cadence Delivers 10 New Verification IP Targeting Automotive, Hyperscale Data Center and Mobile Applications 05/19/2020

  • Cadence Announces Industry’s First Verification IP for PHY Covering Multiple Protocols 02/26/2020

  • Cadence Announces First-to-Market NVMe 1.4 Verification IP for High-Performance Computing 10/22/2019

  • Cadence Announces First-to-Market DisplayPort 2.0 Verification IP 06/26/2019

  • Cadence Announces Broad Next-Generation Memory Standard Support in Samsung Foundry’s Advanced Process Technologies 05/14/2019

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Customers

Cadence’s development of verification solutions for USB4 is a key step forward for the development of compliant designs and ensuring the continued growth of the Thunderbolt ecosystem based on USB open standards.

Jason Ziller, general manager of Client Connectivity Division at Intel

Broadcom has been a leader in the Bluetooth market for more than 15 years, and we continue to invest in mobile wireless technology to grow our market position. With Cadence VIP for Bluetooth 5, engineers can focus on designing complex SoCs and delivering more value to end customers.

Michael Hurlston, senior vice president and general manager at Broadcom

When faced with the important decision as to which IP vendor has the most reputable and silicon-proven PCI Express IP...we rely on Cadence's high-quality, interoperable design and verification IP solutions, and excellent customer support to meet the PCIe 2.0 and IOV specifications...

Jim Finnegan, senior vice president of Silicon Engineering at Netronome

Cadence PCIe 3.0 Verification IP has enabled us to thoroughly verify that our designs comply with the PCIe 3.0 specification and the new PCIe 4.0 product demonstrates the company’s commitment to supporting engineers working with this key protocol.

Balaji Kanigicherla, founder, CTO and vice president of Engineering at Ineda Systems

The Cadence solution for PCIe 5.0 is important to our development of the next generation of our products, to support the need for faster data speeds for high-performance, machine learning, cloud, storage and more applications.

Shlomit Weiss, senior vice president, silicon engineering at Mellanox Technologies

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Cadence is committed to keeping design teams highly productive. A range of support offerings and processes helps Cadence users focus on reducing time-to-market and achieving silicon success. Overview

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