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デジタル設計/サインオフ

ケイデンスのデジタル設計/サインオフ検証ソリューションは、早期のデザイン・クロージャーと予測性の高い設計フローを実現し、パワー、パフォーマンス、エリア(PPA)の目標を達成します。

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カスタムIC/アナログ/RF設計

ケイデンスのカスタム、アナログおよびRF設計ソリューションは、ブロック・レベルおよびミックスシグナルデザインのシミュレーションから自動配線、ライブラリ・キャラクタライゼーションまで、多くのタスクを自動化することで設計TATを短縮できます。

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ケイデンスのVerification Suiteに統合されたシステム設計および検証ソリューションは、シミュレーション、アクセラレーション、エミュレーション、および検証マネージメント機能を提供します。

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様々なアプリケーションに向けたSoC設計をカスタマイズするための広範なIPプラットフォーム。

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ケイデンスのICパッケージ設計製品は、先進パッケージング、システムのプランニング、相互互換なマルチファブリック設計をサポートし、自動化による効率化と高精度な設計を実現します。

PRODUCT CATEGORIES

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システム解析

ケイデンスのシステム解析ソリューションは、高精度な電磁界ソルバーおよびシミュレーション技術を提供し、システムが広範囲な動作条件下で動作することを検証します。

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Palladium Z1 Enterprise Emulation Platform

高速なエミュレーション・スループットと最適な作業効率でグローバルな設計チームをサポート

データシート Read White Paper
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Key Benefits

  • 企業レベルの信頼性と拡張性、5倍のエミュレーション・スループット
  • 高度なターゲット仮想再配置、ジョブの再作成機能によるリソースの最適な利用
  • ラックベースのブレード・アーキテクチャにより、フットプリントを92%削減

SoC開発における最大の課題は検証です。しかし、従来の検証ツールは、SoC/ASIC設計の規模や複雑さが急速に増大するペースに対応できていませんでした。RTLやゲート設計のサイズが増大するにつれて、シミュレータは大変遅くなりました。そして、これがシステム統合を遅延させ、検証サイクル全体を引き延ばしています。

業界初のデータセンタークラスのエミュレーション・システムであるPalladium® Z1プラットフォームは、検証の生産性のギャップを埋め合わせることで、SoC、サブシステム、IPブロックの検証、およびシステムレベルの検証を高速化します。

ケイデンスでは、(1世代前の)Palladium XP II プラットフォームにより、シミュレーション・アクセラレーション技術とエミュレーション技術が統合されており、競合製品に比べてエミュレーションのスループットが最大5倍、作業効率が平均で2.5倍向上を実現しています。

Palladium® Z1プラットフォームではさらに、以下の機能を強化しています。

Palladium Z1
管理と拡張が容易なプラットフォーム:
  • 異なる作業に対し、1台のワークステーションあたり最大140MG/時のコンパイル速度でデータベースをコンパイル
  • できるだけ多くの作業の割り当て
  • 優先順位に基づいた作業の実行
  • プレシリコン、ポストシリコン両方のバグのデバッグ

エミュレーション用リソースのスマートな利用

Palladium Z1プラットフォームでエミュレーション用リソースを管理することで、時間と労力を節約できます。このプラットフォーム独自の仮想ターゲット再配置機能と高度なジョブ作成・配置により、ペイロードを実行時に利用可能なリソースに割り当てて再コンパイルを回避します。このプラットフォームでは、400万のゲート精度で2,304個の並列ジョブを実行でき、最大92億ゲートまで拡張できます。

Palladium XP II環境に比べて、この新しいプラットフォームではエミュレーションサイクル毎の電力消費を1/3以下に、電力密度を最大44%まで削減します。以下の要素により電力上のメリットが生じています。

  • システム利用と並列ユーザー数が平均で2.5倍
  • エミュレーションのスループットを最大5倍改善
  • 1時間当たりのコンパイル時間が最大140MG
  • デバッグ深度とアップロード速度の向上

ラックベースのブレード・アーキテクチャにより、Palladium XP IIプラットフォームに比べてフットプリントを92%削減し、ゲート密度を8倍に向上しました。Palladium Z1のプロセッサ・ベースのコンピューティング・エンジンは大規模並列処理を用いて設計されていて、競合製品に比べて4倍のユーザー精度を実現しています。

Palladium Z1プラットフォームは、コンパイル・フローの間、ソフトウェア開発、システム検証、ハードウェアの不具合に対して、Protium S1 FPGA-Based Prototyping Platformに適合します。

機能

  • プロセッサ・ベースのコンピューティング・エンジンとVerification Xccelerator Emulator(VXE)ソフトウェアは、最大2倍のコンパイル速度で高性能な検証を実行でき、柔軟な新しいユースモデルをサポート
  • Virtual Verification Machine(VVM)は、インタラクティブなオフラインデバッグが可能
  • Cadence Xcelium®シミュレータのユーザーは、再コンパイルなしでシミュレーションからアクセラレーションにホットスワップ
  • インテリジェントな高速自動コンパイラにより、素早い立ち上げが可能
  • 包括的なCadence SpeedBridge® AdapterポートフォリオとAccelerated Verification IPにより、システムレベルの素早い立ち上げが可能
  • Cadence Joules™ RTL Power Solutionとの相互運用により、動的な電力解析と検証が可能
  • 迅速なドライバ開発と設計検証向けに、事前承認済み、構成済みのUSBとPCI Express®用Emulation Development Kit(EDK)ポートフォリオをサポート
  • カバレッジとメトリクス・ドリブン検証をサポート
  • 早期のハードウェア/ソフトウェア設計の検証、包括的な検証とリユース手法の埋め込みテストベンチ用のハイブリッド環境を提供
  • Cadence Stratus™ High-Level Synthesis(HLS)とのハイレベルな統合により、ハイレベルな抽象化モデルをシステム検証環境に統合可能
  • Cadence Perspec™ System Verifier for SoCsによるケースベースの検証をサポートし、システムレベルの複雑なカバレッジドリブン・テストの開発時間を短縮

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Your one-stop shop for all protocols and memories

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Verification Suite

Reduce system integration time by up to 50%

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Learn how this Dynamic Duo provide performance at 10s of MHz for billion gate sized designs, in a unified compile and debug environment for fast bring-up and full hardware/software debugging

Verify Smarter with Industry's First Datacenter-Class Emulation System

Emulating NVIDIA GPUs with Cadence Emulation Products

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    • Cadence Verification Suite
    • Palladium Hybrid
    • Palladium Dynamic Power Analysis
    • Protium S1 FPGA-Based Prototyping Platform
    • Protium X1 Enterprise Prototyping Platform
    • SpeedBridge Adapters
    • Xcelium Logic Simulation
    • VirtualBridge Adapters
    • Emulation Development Kit
    • Accelerated Verification IP
    • QuickCycles Service
    • Palladium Cloud
    • Virtual Debug Interface for Software Debuggers
Resource Library

Video (33)

  • Pushbutton migration from emulation to prototyping based on Protium platform
  • Conquer IP Functional Verification with Formal and Simulation Approach
  • +Perspec on Palladium - New Efficient Bus-Performance Verification Techniques
  • Productive Design: Hardware/Software Co-Verification with Virtual Debugging from Simulation to Prototyping
  • Do’s and Don’ts of Emulating Next-Generation Multi-Billion-Gate Ethernet and InfiniBand Interconnect Devices While Optimizing Verification Productivity and Meeting Development Schedu
  • GSP Emulation with Palladium Platform and Prototyping with Protium Platform
  • SoC Firmware Debugging Tracer in Emulation Platform
  • Improving Firmware Validation Productivity and Debug Efficiency Using Palladium Z1 Platform and Indago Debug Analyzer
  • Digital Twin Case Study: Applying Emulation-Based Verification of SoC Using Tactical Software
  • Create Palladium Design Equivalent to Both Specification and Gate Implementation on Silicon
  • DFT DFD verification acceleration on Palladium
  • Accelerate Baidu Kunlun AI chip development based on Palladium Z1 platform
  • Accelerating software bring up and debug on emulator with a fluent migration from Palladium to Protium
  • Fujitsu Designing the World’s Leading Innovations with Cadence Intelligent System Design
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  • Marvell Gains High Confidence for Silicon Tapeout Using Palladium Emulator to Validate Processor
  • Early Firmware Development on Palladium and Protium, Enables 1st Silicon Success at Toshiba Memory
  • Green Hills Software Partners with Cadence to Accelerate Embedded System Safety and Security
  • Building better aerospace and defense electronics: emulate before you fabricate
  • Cadence Delivers Verification Throughput
  • Palladium and Protium Dynamic Duo
  • Accelerate Your Time to Debug Root Cause
  • Palladium and Protium Dynamic Duo
  • NVIDIA Partners with Cadence to Overcome Chip Design Challenges
  • The Palladium Solution and SoC Emulation for 16nm Automotive Devices at NXP
  • Using the Cadence VirtualBridge Emulator with the Palladium Platform
  • Taking FPGA-Based Prototyping to the Next Level
  • CDNLive India – A Closer Look at State-of-the-Art Verification Techniques and Methodologies
  • Palladium Z1: Advanced Job Re-shaping
  • Emulating Nvidia GPUs
  • NVIDIA Handles Complexity with Palladium Z1 Platform
  • Verify Smarter with Industry's First Datacenter-Class Emulation System
  • National and Cadence Building a More Efficient Chip Design Flow

Datasheet (11)

  • Memory Model Portfolio for Palladium Series Datasheet
  • VirtualBridge Adapter for PCI Express 2.0/3.0 Datasheet
  • Virtual JTAG Virtual JTAG Debug Interface Datasheet
  • Palladium Z1 Enterprise Emulation Platform Datasheet
  • Cadence SpeedBridge Adapter for USB 2.0 Host Datasheet
  • Cadence SpeedBridge Adapter for PCI Express 3.0 Datasheet
  • Cadence SpeedBridge Adapter for Serial ATA (SATA) Datasheet
  • SpeedBridge Adapter for USB 3.0 Devices Datasheet
  • Cadence SpeedBridge Adapter for Ethernet Datasheet
  • Cadence SpeedBridge Adapter for Serial-Attached SCSI (SAS) Datasheet

White Paper (2)

  • Improving Emulation Throughput for Multi-Project SoC Designs White Paper
  • A Better Tool for Functional Verification of Low-Power Designs with IEEE 1801 UPF White Paper

Press Releases (33)

  • Nuvoton, ケイデンスのPalladium Z1 Enterprise Emulation Platformを活用し、MCUデザインの開発を加速
  • ケイデンス、Arm Cortex-A78およびCortex-X1 CPU搭載モバイル機器開発向けに デジタル設計フルフローおよびVerification Suiteを最適化
  • Acacia Communications Adopts Cadence Palladium Z1 Enterprise Emulation Platform to Accelerate Optical Networking Development
  • Thinci、AI設計にCadence Verification Suiteを採用し、 プロジェクトスケジュールを数か月加速
  • ケイデンス、シリコン製造開始前のArmベアメタルの コンプライアンステスト自動化により、Armベースサーバーの開発を加速
  • Cadence Accelerates Arm-Based Server Development by Automating Arm Pre-Silicon Bare Metal Compliance Testing
  • ケイデンスのPalladium Z1 Enterprise Emulation Platformが GUCのSoC設計を加速
  • Cadence Palladium Z1 Enterprise Emulation Platform Enables GUC to Accelerate SoC Design
  • ケイデンスのデジタル設計フルフロー、サインオフ、およびシステム機能検証製品群、7nm Arm Cortex-A76 CPUデザインに最適な結果を提供
  • ケイデンス、自動車機能安全規格ISO 26262認証機関TÜV SÜDより 業界初めて包括的な「TCL1適格」認定を取得
  • Cadence Achieves TÜV SÜD’s First Comprehensive “Fit for Purpose - TCL1” Certification in Support of Automotive ISO 26262 Standard
  • ケイデンスPalladium Z1 Emulator向けにVirtualBridge Adapterを発表、ソフトウェアの立ち上げ期間を最大で3か月短縮
  • ケイデンスのPerspec System Verifierを使用し、ルネサスがMCUの設計を加速
  • Cavium社がケイデンス Palladium Z1エンタープライズ・エミュレーション・プラットフォームを採用
  • ケイデンスのハードウェアエミュレータPalladium Z1開発チームが米国ACE (Annual Creativity in Electronics)アワードを受賞
  • ケイデンス、自動車機能安全規格ISO 26262に対応する業界初の包括的なTCL1ドキュメントを提供
  • 富士通、「ポスト京」スーパーコンピューター開発にケイデンスのPalladium Z1エンタープライズ・エミュレーションプラットフォームを採用
  • ルネサス エレクトロニクス、ケイデンスのInterconnect Workbenchを採用し、オンチップインターコネクトのパフォーマンス解析および検証を加速
  • ケイデンス、ARMのCoretex-A73 CPUおよびMali-G71 GPUコア向け10nmリファレンスフローのRAK(Rapid Adoption Kits)を提供
  • ケイデンス、Palladium Z1 エンタープライズ・エミュレーションプラットフォームを発表、データセンタークラス・エミュレーションの新たな時代をリード
  • Cadence Ushers in New Era of Datacenter-class Emulation with Palladium Z1 Enterprise Emulation Platform
  • Altair Semiconductor Adopts Cadence Palladium XP Platform for Advanced IoT SoC Development
  • Realtek Accelerates System-on-Chip Verification with Cadence Palladium XP Platform
  • Cadence Announces Next-Generation JasperGold Formal Verification Platform
  • Media Alert: Cadence to Showcase System Design and Verification Solutions at DVCon US 2015
  • M31 Technology Adopts Cadence Verification IP to Achieve 2.5X Faster Verification
  • DMP Adopts Cadence Palladium XP Platform to Accelerate High Performance Graphic IP Core Development
  • Cadence Perspec System Verifier Delivers Up to 10X Productivity Improvement in System-on-Chip Verification
  • Cadence Introduces Automotive Functional Safety Verification Solution, Reducing ISO 26262 Compliance Preparation Effort by up to 50 Percent
  • CSR Selects Cadence Palladium XP Platform for Development of ARM-based Automotive Infotainment Systems
  • HiSilicon Expands Cadence Palladium XP Platform Usage For Mobile and Digital Media SoC and ASIC Development
  • Cadence Redefines Verification Planning and Management with Incisive vManager Solution
  • Ricoh Selects Cadence Palladium XP Platform for Next-Generation Multifunction Printer SoC Development

Customer Presentation (7)

  • Pushbutton migration from emulation to prototyping based on Protium platform
  • Conquer IP Functional Verification with Formal and Simulation Approach
  • +Perspec on Palladium - New Efficient Bus-Performance Verification Techniques
  • Productive Design: Hardware/Software Co-Verification with Virtual Debugging from Simulation to Prototyping
  • SoC Firmware Debugging Tracer in Emulation Platform
  • Digital Twin Case Study: Applying Emulation-Based Verification of SoC Using Tactical Software
  • Accelerate Baidu Kunlun AI chip development based on Palladium Z1 platform
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Videos

Palladium and Protium Dynamic Duo

Technology day - Adopting Effective Power Analysis Strategies from System to Silicon

The Palladium Solution and SoC Emulation for 16nm Automotive Devices at NXP

Palladium Z1: Advanced Job Re-shaping

NVIDIA Handles Complexity with Palladium Z1 Platform

National and Cadence Building a More Efficient Chip Design Flow

News ReleasesVIEW ALL
  • ケイデンス、新しいSystem VIPソリューションにより 検証IPをチップレベルに拡張 10/14/2020

  • Nuvoton, ケイデンスのPalladium Z1 Enterprise Emulation Platformを活用し、MCUデザインの開発を加速 08/18/2020

  • ケイデンス、マシンラーニングを適用したXcelium論理シミュレータを提供、 リグレッション検証を最大5倍高速化 08/13/2020

  • ケイデンス、Arm Cortex-A78およびCortex-X1 CPU搭載モバイル機器開発向けに デジタル設計フルフローおよびVerification Suiteを最適化 05/27/2020

  • Cadence Automotive Reference Flow Certified by Samsung Foundry for Advanced-Node Design Creation 10/17/2019

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Customers

Due to the Palladium Z1 platform's capacity to handle our billion gate-class designs and its highly sophisticated debug and advanced multiuser capabilities, all in a small form factor, we will be able to design and deliver our next generation GPU and Tegra designs with high quality and on schedule.

Narenda Konda, Director of Engineering, NVIDIA

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The Palladium Z1 platform uniquely met our requirements due to its reliability as a datacenter compute resource, offering advanced multi-user capabilities and scalability from small four-million-gate verification payloads to multi-billion gate designs.

Daniel Diao, Deputy General Manager of the Turing Processor Business Unit, Huawei

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Cadence is committed to keeping design teams highly productive. A range of support offerings and processes helps Cadence users focus on reducing time-to-market and achieving silicon success. Overview

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