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デジタル設計/サインオフ

ケイデンスのデジタル設計/サインオフ検証ソリューションは、早期のデザイン・クロージャーと予測性の高い設計フローを実現し、パワー、パフォーマンス、エリア(PPA)の目標を達成します。

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カスタムIC/アナログ/RF設計

ケイデンスのカスタム、アナログおよびRF設計ソリューションは、ブロック・レベルおよびミックスシグナルデザインのシミュレーションから自動配線、ライブラリ・キャラクタライゼーションまで、多くのタスクを自動化することで設計TATを短縮できます。

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システム設計/検証

ケイデンスのVerification Suiteに統合されたシステム設計および検証ソリューションは、シミュレーション、アクセラレーション、エミュレーション、および検証マネージメント機能を提供します。

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IP

様々なアプリケーションに向けたSoC設計をカスタマイズするための広範なIPプラットフォーム。

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ICパッケージ

ケイデンスのICパッケージ設計製品は、先進パッケージング、システムのプランニング、相互互換なマルチファブリック設計をサポートし、自動化による効率化と高精度な設計を実現します。

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システム解析

ケイデンスのシステム解析ソリューションは、高精度な電磁界ソルバーおよびシミュレーション技術を提供し、システムが広範囲な動作条件下で動作することを検証します。

  • See how to improve electrical-thermal co-simulation with the Celsius™ Thermal Solver Watch Now
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組み込みソフトウェア

プリント基板設計/解析

ケイデンスのPCB設計ソリューションは、コンポーネント設計とシステムレベルシミュレーションの統合によりコンストレイント・ドリブンな設計フローを提供し、より短時間で予測可能な設計サイクルを実現します。

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PCB Analysis

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高速PCB解析のための完全な設計フロー

メモリインターフェースは8年前のシリアルリンクのように見え始めています(DDR4の関連記事を参照)。 LPDDR4が4,266 Mtpsに達すると予想されるため、トランスミッタのフィード・フォワード・イコライゼーション(FFE)やシミュレーション用のアルゴリズミック・モデルが必要となるレシーバのアダプティブ・イコライゼーションなど、シリアルリンクで使用される技術が増えています。

JEDECではビット・エラー・レートテストが必要になるため、LPDDR4インターフェースを完全にテストするには、IBIS-AMIモデルによる大容量シミュレーションが必要になります。 当社のDDR4ソリューションで紹介されているように、シリアルリンク・チャネルシミュレーションと当社のメモリインタフェース・コンプライアンステストを独自に統合することにより、短期間で数百万ビットのシミュレーションが可能で、ビットエラーレート解析を実現します。 これにより、従来の回路シミュレーションの能力を上回るLPDDR4インターフェースを通じて数十万〜数百万ビットのトラフィックを実行する独自の能力をお客様に提供します。

Cadence® Sigrity SystemSIツールは、PCB解析プロセスを通じて完全な設計フローを提供するAllegro® Sigrity Power-Aware SIソリューションの一部です。

主な利点

  • 反射、損失、クロストーク、同時スイッチング出力(SSO)エフェクトの同時シミュレーション
  • 大規模インターコネクト構造の効率的なSパラメータ抽出のためのハイブリッドソルバ
  • 高周波構造の詳細な抽出のための3Dフルウェープ・ソルバ
  • 測定用波形の包括的な JEDEC ベースのポストプロセッシング

DDR4 Power-Aware Signal Integrity Adopting Serial Link Simulation Techniques

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Cadence Solves the Challenges Faced by Mobiveil Technologies Hardware Group

SiriusXM Simulates DDR3 Interfaces with Sigrity Tools

Nexus Interposers and Cadence Tools Enhance DDRx Designs

Ericsson Meets DDR and PCIe Specs While Avoiding Crosstalk

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  • Cadence Sigrity 2016 Portfolio Improves Product Creation Time with PCB Design and Analysis Methodology for Multi-Gigabit Interfaces 01/19/2016

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