SiP Layout Optionは、Allegro® Package Designer Plusの機能を強化し、高性能で複雑なパッケージの設計を可能にします。半自動配線フロー、配線、ならびにチューニングの強力な機能群が追加され、DDR、高速シリアル、シリコンサブストレート、グラフィックインターフェースなどの重要なインターコネクトのプランニング、最適化、配線、タイミングクロージャといった作業をスピーディに実現します。インテリジェントな配線フロープランニングと自動化されたブレークアウトのツールにより、時間を要し単調な手作業による配線引き出しと配線のタスクを軽減し、大規模バス配線に使用するスペースと配線層が最小になるように最適化します。
SiP Layout Optionを利用することにより、DesignTrue DFMテクノロジーの拡張機能へのアクセスが可能となります。DesignTrue DFMによるリアルタイムでのマニュファクチャリング・チェックとアセンブリ・ルールの全機能を活用することで、サブストレートの歩留まりを改善し、製造やアセンブリの際の問題を回避できます。このオプションは、製造バリエーションの評価と、同じマスター設計から派生しつつサブストレートのスタックアップ、ダイスタッキング、ワイヤーボンディングの構成が異なるバリアント設計をサポートしています。また、IC/パッケージ協調設計対応として、Virtuoso®プラットフォームとの双方向フローを可能にします。
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