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デジタル設計/サインオフ

ケイデンスのデジタル設計/サインオフ検証ソリューションは、早期のデザイン・クロージャーと予測性の高い設計フローを実現し、パワー、パフォーマンス、エリア(PPA)の目標を達成します。

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カスタムIC/アナログ/RF設計

ケイデンスのカスタム、アナログおよびRF設計ソリューションは、ブロック・レベルおよびミックスシグナルデザインのシミュレーションから自動配線、ライブラリ・キャラクタライゼーションまで、多くのタスクを自動化することで設計TATを短縮できます。

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システム設計/検証

ケイデンスのVerification Suiteに統合されたシステム設計および検証ソリューションは、シミュレーション、アクセラレーション、エミュレーション、および検証マネージメント機能を提供します。

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IP

様々なアプリケーションに向けたSoC設計をカスタマイズするための広範なIPプラットフォーム。

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ICパッケージ

ケイデンスのICパッケージ設計製品は、先進パッケージング、システムのプランニング、相互互換なマルチファブリック設計をサポートし、自動化による効率化と高精度な設計を実現します。

PRODUCT CATEGORIES

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  • SI/PI解析統合ソリューション
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システム解析

ケイデンスのシステム解析ソリューションは、高精度な電磁界ソルバーおよびシミュレーション技術を提供し、システムが広範囲な動作条件下で動作することを検証します。

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組み込みソフトウェア

プリント基板設計/解析

ケイデンスのPCB設計ソリューションは、コンポーネント設計とシステムレベルシミュレーションの統合によりコンストレイント・ドリブンな設計フローを提供し、より短時間で予測可能な設計サイクルを実現します。

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Virtuoso Layout Suite

Accelerated full custom IC layout

Virtuoso Layout Suite GXL DATASHEET Virtuoso Layout Suite XL データシート
  • Overview
  • Resources
  • Videos
  • News and Blogs
  • Support and Training

Key Benefits

  • Supports custom analog, digital, and mixed-signal designs at the device, cell, block, and chip levels
  • Accelerated performance and productivity from advanced full custom polygon editing through more flexible schematic and constraint-driven assisted full custom layout, to full custom layout automation
  • Enables creation of differentiated custom silicon that is both fast and silicon accurate

As the full custom IC layout suite of the industry-leading Cadence® Virtuoso® platform, the Virtuoso Layout Suite supports custom analog, digital, and mixed-signal designs at the device, cell, block, and chip levels. The enhanced Virtuoso Layout Suite offers accelerated performance and productivity from advanced full custom polygon editing (L) through more flexible schematic-driven and constraint-driven assisted full custom layout (XL), to full custom layout automation (GXL). Seamlessly integrated with the Virtuoso Schematic Editor and the Virtuoso Analog Design Environment, the Virtuoso Layout Suite enables the creation of differentiated custom silicon that is both fast and silicon accurate.

The Virtuoso platform is the industry’s most silicon-proven, comprehensive, custom IC design platform, trusted in taping out thousands of designs each year for more than 25 years.

  • Virtuoso Layout Suite L Datasheet
  • Virtuoso Layout Suite XL Datasheet
  • Virtuoso Layout Suite GXL Datasheet

Features

  • New patented Virtuoso Layout Suite L graphics-rendering engine provides from 10X to 100X accelerated zoom, fit, pan, drag, and redraw performance on large layouts
  • New Virtuoso Layout Suite XL connectivity extractor technology accelerates trace net, probe net, and mark net performance from 10X to 50X on large layouts
  • Patented multi-user Express PCell capability continues to boost design opening performance from 10X to 20X whenever users require PCell evaluation
  • New patented stream-in engine provides accelerated performance from 2X to 20X
  • Virtuoso Layout Suite GXL Space-Based Routing technology automatically enforces process and design rules during interactive and assisted wire and bus editing
  • Virtuoso Layout Suite GXL ModGens (module generators) add a new interactive pattern-manipulation flow, making real-time customization of a high-precision structured layout very visual and simple
  • Virtuoso Layout Suite GXL Space-Based Routing technology at chip levels can deliver high-quality constraint-driven specialty routing to close thousands of nets in minutes, and new structured device-level routing capabilities that can enhance routing productivity by as much as 50%
  • The Virtuoso platform is backed by the largest number of process design kits (PDKs) available from the world’s leading foundries, for process nodes everywhere from mature 0.6µm to advanced 7nm process nodes
Image showing layout pane of Virtuoso Layout Suite XL
Vituoso Layout Suite XL
  • Related Products

    • Virtuoso Schematic Editor
    • Virtuoso ADE Product Suite
    • Virtuoso Layout Suite EAD
    • Virtuoso Space-Based Router
    • Silicon Signoff and Verification
    • Virtuoso Digital Implementation
Resource Library

Video (47)

  • Samsung Foundry AMS Design Reference Flow - Advanced Node
  • Lightelligence Powers the Next Generation of Innovations Using Integrity 3D-IC Platform
  • Lightelligence社、ケイデンスのソリューションにより世界初の実用的な光コンピューティング・システムを設計
  • Sequans Designs its Future 5G IoT Platform Using Virtuoso RF Solution
  • Application of Virtuoso CurvyCore Technology in the Development of Photonic Elements for a Foundry Process Design Kit (PDK)
  • Current Data-Driven Analog Routing Using Virtuoso SDR
  • On the Silicon Photonics Physical Design’s Productivity and Reliability Enhancement
  • Useful Utilities and Helpful Hacks
  • Dragon Unleashed: Voice to Virtuoso Environment
  • Samsung 3nm Cadence AMS Design Reference Flow
  • CLE Layout Development Methodologies to Enhance Productivity of Full Custom I/O and Test-Chip Design
  • CadenceTECHTALK: Maximizing Custom Layout Productivity even as the Circuit Changes
  • Design Intent Brings Efficient Communication in Analog Design
  • On-Time 5G RFICs with Fast EM Simulation and Integrated Design Flow
  • Analog Layout Automation Flow Aimed to Improve Process Porting Efficiency with Virtuoso ModGen Framework
  • Technology Update: Virtuoso Design Platform 20.1 Update
  • Advanced Layout Implementation Utilizing Analog APR Flow
  • Enhancing Design Productivity by Managing RV and Parasitic Data in Real Time During Layout Implementation
  • Increase Layout Productivity Through Accurate Area Estimation for Schematic Hierarchy
  • Automated VDR Tagging and Verification Flow for Advanced Node Design
  • From The Best Usage Of Advanced Virtuoso Functionalities
  • Improve Device Matching with Assisted Component P&R
  • How Row-Based Methodology Improves Custom Layout
  • Using Row-Based Methodology to Improve Advanced-Node Custom Layout
  • Minimize Layout Iterations and ​ EM Errors with Simulation-Driven Routing
  • Advanced Methodologies to Accelerate Your Custom Layout
  • Webinar: Improving Custom Layout with Advanced Design Methodologies - Session Two
  • Webinar: Improving Custom Layout with Advanced Design Methodologies - Session One
  • Virtuoso Layout Suite Update
  • Virtuoso ADE Product Suite - Design Excellence Re-Imagined
  • Remove Custom Layout Bottlenecks with Concurrent Editing
  • Virtuoso Design Platform for Next-Generation Custom IC and System Design
  • Toshiba Electronic Device Solutions Overcomes Complexities of Advanced-Node Designs
  • Meeting the Challenges of Chip Design Using the Virtuoso Suite
  • 次世代のカスタムIC/システム設計向けNew Virtuoso System Design Platform
  • New Virtuoso Design Platform for Next-Generation Custom IC and System Design
  • STMicroelectronics - Improving Productivity with Virtuoso SPD
  • ams Reduces IC Development Effort by Collaborating with Cadence on Layout Productivity
  • Cadence Pattern Matching and DFM Signoff
  • Celebrating 25 Years of Virtuoso Innovation
  • Fairchild Semiconductor Eases Floorplanning Challenges of Mixed-Signal Design with Virtuoso Platform
  • Cadence In-Design DFM-LDE Adoption in ST SmartPower PDK
  • Using VSR for Chip Routing on ST smARTpower Technologies
  • Place-and-Route in Under a Day for Allegro Microsystems
  • Analog Devices Raises Productivity with ModGen Tools
  • Freescale Accelerates Layout Via Constraint-Driven Design Flow

Presentation (13)

  • Samsung Foundry AMS Design Reference Flow - Advanced Node
  • Application of Virtuoso CurvyCore Technology in the Development of Photonic Elements for a Foundry Process Design Kit (PDK)
  • Current Data-Driven Analog Routing Using Virtuoso SDR
  • On the Silicon Photonics Physical Design’s Productivity and Reliability Enhancement
  • Useful Utilities and Helpful Hacks
  • Dragon Unleashed: Voice to Virtuoso Environment
  • Samsung 3nm Cadence AMS Design Reference Flow
  • CLE Layout Development Methodologies to Enhance Productivity of Full Custom I/O and Test-Chip Design
  • Advanced Custom Layout Methodologies
  • New Virtuoso Design Platform
  • Technology Update: Virtuoso Design Platform 20.1 Update
  • Advanced Layout Implementation Utilizing Analog APR Flow
  • Automated VDR Tagging and Verification Flow for Advanced Node Design

Datasheet (4)

  • Virtuoso Layout Suite GXL Datasheet
  • Virtuoso Layout Suite L Datasheet
  • Virtuoso Layout Suite for Electrically Aware Design Datasheet

Customer Presentation (3)

  • Analog Layout Automation Flow Aimed to Improve Process Porting Efficiency with Virtuoso ModGen Framework
  • Enhancing Design Productivity by Managing RV and Parasitic Data in Real Time During Layout Implementation
  • Increase Layout Productivity Through Accurate Area Estimation for Schematic Hierarchy

Press Releases (26)

  • グローバルファウンドリーズ、ケイデンスとの協業により22FDXプラットフォーム向けMixed-Signal OpenAccess PDKを提供し、高度なミックスドシグナル設計およびmmWave設計を実現 | Cadence
  • ケイデンスのデジタル設計およびカスタム設計フローが TSMCのN3プロセステクノロジーで認証を取得 | Cadence
  • Cadence to Acquire AWR Corporation from National Instruments to Accelerate System Innovation for 5G RF Communications | Cadence
  • Cadence and National Instruments Enter into Strategic Alliance Agreement to Enhance Electronic System Innovation | Cadence
  • Cadence Custom/AMS Flow Certified for Samsung 5LPE Process Technology | Cadence
  • Cadence Design Solutions Certified for TSMC-SoIC Advanced 3D Chip Stacking Technology | Cadence
  • Cadence Collaborates with TSMC to Accelerate 5nm FinFET Innovation, Enabling Next-Generation SoC Production Design | Cadence
  • Cadence Custom/AMS Flow Certified on Samsung 7LPP Process Technology | Cadence
  • Cadence Achieves EDA Certification for TSMC 5nm and 7nm+ FinFET Process Technologies to Facilitate Mobile and HPC Design Creation | Cadence
  • Cadence Supports New TSMC WoW Advanced Packaging Technology | Cadence
  • Cadence Full-Flow Digital and Signoff Tools and Custom/Analog Tools Certified and Enabled for Intel 22FFL Process Technology | Cadence
  • ケイデンスツールおよびフローがTSMCの12FFCプロセス向けに認証を取得 | Cadence
  • Cadence Tools and Flows Achieve Production-Ready Certification for TSMC’s 12FFC Process | Cadence
  • Cadence Collaborates with TSMC to Advance 7nm FinFET Plus Design Innovation | Cadence
  • ケイデンスのカスタム/アナログ、フルフローデジタルおよびサインオフツールGLOBALFOUNDRIESの7LPプロセスノードで利用可能に | Cadence
  • Cadence Custom/Analog and Full-Flow Digital and Signoff Tools Enabled for GLOBALFOUNDRIES 7LP Process Node | Cadence
  • ケイデンスのデジタル、サインオフ、およびカスタム/アナログツール、Samsungの7LPPおよび8LPPプロセス技術で利用可能に | Cadence
  • Cadence Custom/Analog, Digital and Signoff Tools Achieve Certification on Samsung 28FDS Process Technology | Cadence
  • Cadence Digital, Signoff and Custom/Analog Tools Enabled on Samsung’s 7LPP and 8LPP Process Technologies | Cadence
  • STマイクロエレクトロニクス、SmartPowerテクノロジー向けにケイデンスの次世代Virtuosoプラットフォームを導入 | Cadence
  • Cadence Unveils Next-Generation Virtuoso Platform Featuring Advanced Analog Verification Technologies and 10X Performance Improvements Across Platform | Cadence
  • Silicon Labs Significantly Reduces Design Time Using the Cadence Mixed-Signal Low-Power Flow | Cadence
  • Cadence Collaborates with Lumerical and PhoeniX Software to Offer Virtuoso Platform-Based Design Flow for Electronic /Photonic ICs | Cadence
  • Cadence Unveils Virtuoso Advanced-Node Platform for 10nm Processes | Cadence
  • Cadence and Intel Collaborate to Release 14nm Library Characterization Reference Flow for Customers of Intel Custom Foundry | Cadence
  • オン・セミコンダクター、電気特性を考慮した設計向けにケイデンスのVirtuoso Layout Suiteを採用 | Cadence

Webinar (12)

  • CadenceTECHTALK: Maximizing Custom Layout Productivity even as the Circuit Changes
  • Improve Device Matching with Assisted Component P&R
  • How Row-Based Methodology Improves Custom Layout
  • Using Row-Based Methodology to Improve Advanced-Node Custom Layout
  • Minimize Layout Iterations and ​ EM Errors with Simulation-Driven Routing
  • Advanced Methodologies to Accelerate Your Custom Layout
  • Webinar: Improving Custom Layout with Advanced Design Methodologies - Session Two
  • Webinar: Improving Custom Layout with Advanced Design Methodologies - Session One
  • Virtuoso Layout Suite Update
  • Virtuoso ADE Product Suite - Design Excellence Re-Imagined
  • Remove Custom Layout Bottlenecks with Concurrent Editing

Success Story Video (3)

  • Validating Design Intent and Improving Design Quality at Micron
  • Analog Devices Raises Productivity with ModGen Tools
  • Freescale Accelerates Layout Via Constraint-Driven Design Flow

White Paper (1)

  • Addressing the Challenges of Photonic IC Design Via an Integrated Electronic/Photonic Design Automation Environment, Addressing the Challenges of Photonic IC Design Via an Integrated Electronic/Photonic Design Automation Environment White Paper
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Videos

Lightelligence社、ケイデンスのソリューションにより世界初の実用的な光コンピューティング・システムを設計

On the Silicon Photonics Physical Design’s Productivity and Reliability Enhancement

Samsung 3nm Cadence AMS Design Reference Flow

Design Intent Brings Efficient Communication in Analog Design

Analog Layout Automation Flow Aimed to Improve Process Porting Efficiency with Virtuoso ModGen Framework

From The Best Usage Of Advanced Virtuoso Functionalities

Virtuoso Layout Suite Update

Virtuoso ADE Product Suite - Design Excellence Re-Imagined

次世代のカスタムIC/システム設計向けNew Virtuoso System Design Platform

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  • グローバルファウンドリーズ、ケイデンスとの協業により22FDXプラットフォーム向けMixed-Signal OpenAccess PDKを提供し、高度なミックスドシグナル設計およびmmWave設計を実現 09/25/2020

  • ケイデンスのデジタル設計およびカスタム設計フローが TSMCのN3プロセステクノロジーで認証を取得 08/26/2020

  • Cadence to Acquire AWR Corporation from National Instruments to Accelerate System Innovation for 5G RF Communications 12/02/2019

  • Cadence and National Instruments Enter into Strategic Alliance Agreement to Enhance Electronic System Innovation 12/02/2019

  • Cadence Custom/AMS Flow Certified for Samsung 5LPE Process Technology 10/17/2019

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