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    • デジタル設計/サインオフ
      デジタル設計/サインオフ 概要

      Cadence® digital design and signoff solutions provide a fast path to design closure and better predictability, helping you meet your power, performance, and area (PPA) targets.

      Full-Flow Digital Solution Related Products A-Z

      製品カテゴリー
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        • ソリューション/フロー
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        • ソリューション/フロー
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      • Low Power検証
        • ソリューション/フロー
        • Conformal Low Power
      • 高位/論理合成
        • ソリューション/フロー
        • Stratus High-Level Synthesis
        • Genus Synthesis Solution
        • Virtuoso Digital Implementation
      • パワー解析
        • ソリューション/フロー
        • Joules RTL Power Solution
      • SDC and CDC Signoff
        • ソリューション/フロー
        • Conformal Litmus
        • Conformal Constraint Designer
      • シリコン・サインオフ/検証
        • ソリューション/フロー
        • Pegasus Verification System
        • Quantus Extraction Solution
        • Tempus Timing Signoff Solution
        • Assura Physical Verification
        • Physical Verification System
        • CMP Predictor
        • MaskCompose Reticle and Wafer Synthesis
        • QuickView Signoff Data Analysis
        • LDE Electrical Analyzer
        • Process Proximity
        • Pattern Analysis
        • Litho Physical Analyzer
        • Voltus IC Power Integrity Solution
        • Voltus-Fi Custom Power Integrity Solution
      • Library Characterization
        • ソリューション/フロー
        • Liberate Trio Characterization Suite
        • Liberate MX Memory Characterization
        • Liberate AMS Mixed-Signal Characterization
        • Liberate LV Library Validation Solution
        • Liberate Characterization Solution
        • Liberate Variety Statistical Characterization
      • テスト
        • ソリューション/フロー
        • Modus DFT Software Solution
      • ソリューション/フロー
        • ソリューション/フロー
        • 3D-IC設計ソリューション
        • Advanced Node設計ソリューション
        • Armベース設計向け検証ソリューション
        • Library Characterization Flow
        • Low Power設計ソリューション
        • ミックスシグナル設計ソリューション
    • カスタムIC/アナログ/RF設計
      カスタムIC/アナログ/RF設計概要

      Cadence® custom, analog, and RF design solutions can help you save time by automating many routine tasks, from block-level and mixed-signal simulation to routing and library characterization.

      概要 Related Products A-Z

      製品カテゴリー
      • 回路設計
        • Flows/Tools
        • What's New in Virtuoso
        • Virtuoso Schematic Editor
        • Virtuoso ADE Product Suite
      • 回路シミュレーション
        • Flows/Tools
        • Spectre Simulation Platform
        • Spectre X Simulator
        • Spectre eXtensive Partitioning Simulator
        • Spectre RF Option
        • Spectre AMS Designer
      • ライブラリ・キャラクタライゼーション
        • Flows/Tools
        • Liberate Trio Characterization Suite
        • Virtuoso Liberate MX Memory Characterization Solution
        • Virtuoso Liberate AMS Mixed-Signal Characterization Solution
        • Liberate Variety Statistical Characterization
        • Liberate Characterization Solution
        • Liberate LV Library Validation Solution
      • レイアウト設計
        • Flows/Tools
        • What's New in Virtuoso
        • Virtuoso Layout Suite
      • レイアウト検証
        • Flows/Tools
        • Virtuoso DFM
        • Physical Verification System
        • Virtuoso Integrated Physical Verification System
      • ソリューション/フロー
        • Flows/Tools
        • Electrically Aware Designソリューション
        • Advanced Node設計ソリューション
        • Virtuoso RF Solution
        • Virtuoso System Design Platform
        • Legato Memory Solution
        • Legato Reliability Solution
        • 5G Systems and Subsystems
    • システム設計/検証
      システム設計/検証 概要

      Cadence® system design and verification solutions, integrated under our Verification Suite, provide the simulation, acceleration, emulation, and management capabilities.

      Verification Suite Related Products A-Z

      製品カテゴリー
      • デバッグ解析
        • Flows/Tools
        • Indago Debug Platform
        • Indago Debug Analyzer App
        • Indago Embedded Software Debug App
        • Indago Protocol Debug App
        • SimVision Debug
      • ハードウェア・エミュレーション
        • Flows/Tools
        • Palladium Z1 Enterprise Emulation System
        • Palladium XP Series
        • Palladium Dynamic Power Analysis
        • Palladium Hybrid
        • SpeedBridge Adapters
        • VirtualBridge Adapters
        • Emulation Development Kit
        • Virtual JTAG Debug Interface
        • Accelerated VIP
        • QuickCycles Services
      • フォーマル/スタティック検証
        • Flows/Tools
        • JasperGold Formal Verification Platform (Apps)
        • Assertion-Based Verification IP
      • FPGAプロトタイピング
        • Flows/Tools
        • Protium S1 Desktop Prototyping Platform
        • Protium X1 Enterprise Prototyping Platform
        • SpeedBridge Adapters
      • 検証プランニング/マネージメント
        • Flows/Tools
        • vManager Metric-Driven Signoff Platform
      • シミュレーション/テストベンチ生成・検証
        • Flows/Tools
        • Xcelium Parallel Simulator
        • Incisive Enterprise Simulator
        • Incisive Functional Safety Simulator
        • Incisive Specman Elite
      • ソフトウェア・ドリブン検証
        • Flows/Tools
        • Perspec System Verifier
        • Indago Embedded Software Debug App
        • Virtual System Platform
      • 検証IP
        • Flows/Tools
        • Accelerated Verification IP
        • Assertion-Based VIP
        • Verification IP (VIP) Catalog
      • ソリューション/フロー
        • Flows/Tools
        • Armベース設計向け検証ソリューション
        • オートモーティブ機能安全ソリューション
        • メトリック・ドリブン検証ソリューション
        • ミックスシグナル検証ソリューション
        • Low Power機能検証ソリューション
    • IP
      IP 概要

      An open IP platform for you to customize your app-driven SoC design.

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      製品カテゴリー
      • Interface IP
        • IP
        • PCI Express IP
        • CCIX IP
        • USB IP
        • SerDes IP
        • Ethernet IP
        • MIPI IP
        • HD Display IP
      • Denali Memory IP
        • IP
        • NAND Flash IP
        • DDR IP
        • HBM2 IP
        • SD / SDIO / eMMC IP
        • Octal and Quad SPI Flash Controller and PHY IP
      • テンシリカ DSP IP (USサイト)
        • IP
        • HiFi DSPs for Audio, Voice, and Speech
        • ConnX DSPs for Radar, Lidar, and Communications
        • Vision DSPs for Imaging, Vision, and AI
        • Fusion DSPs for IoT
        • DNA Processor Family for On-Device AI
        • Tensilica Customizable Processors
        • Tensilica Reference Configuration
      • Analog IP
        • IP
        • Analog IP
      • System / Peripherals IP
        • IP
        • 8051 Microprocessor IP
        • System Bus Peripherals
        • Audio Controllers
      • 検証IP (USサイト)
        • IP
        • Accelerated VIP
        • Assertion-Based VIP
        • Memory Models
        • Simulation VIP
        • Productivity Tools
        • Interconnect Solution
    • ICパッケージ設計/解析
      ICパッケージ設計/解析 概要

      Driving efficiency and accuracy in advanced packaging, system planning, and multi-fabric interoperability, Cadence® package implementation products deliver the automation and accuracy.

      概要 Related Products A-Z

      製品カテゴリー
      • ICパッケージ設計
        • Flows/Tools
        • Allegro Package Designer
        • SiP Digital Architect
      • ICパッケージ向けSI/PI解析ソリューション
        • Flows/Tools
        • Allegro Sigrity SI Base
        • Allegro Sigrity Power-Aware SI Option
        • Allegro Sigrity Serial Link Analysis Option
        • Allegro Sigrity Package Assessment and Extraction Option
        • Allegro Sigrity PI Base
        • Allegro Sigrity PI Signoff and Optimization Option
      • SI/PI解析ツール
        • Flows/Tools
        • Sigrity PowerSI
        • Sigrity PowerDC
        • Sigrity OptimizePI
        • Sigrity System Explorer
        • Sigrity Speed2000
        • Sigrity SystemSI
        • Sigrity Broadband SPICE
        • Sigrity Transistor-to-Behavioral Model Conversion (T2B)
        • Sigrity XtractIM
        • Sigrity XcitePI Extraction
      • IC/パッケージ/ボード協調設計・検証
        • Flows/Tools
        • OrbitIO Interconnect Designer
        • IO-SSO Analysis Suite
      • ソリューション/フロー
        • Flows/Tools
        • Substrate設計ソリューション
        • IC/パッケージ/ボード協調設計ソリューション
        • InFO パッケージ設計ソリューション
        • Sigrityテクノロジー最新情報
        • Virtuosoとの統合設計環境
        • PDN(power delivery network)設計
    • SYSTEM INNOVATION
    • システム解析
      システム解析概要

      Cadence® system analysis solutions provide highly accurate electromagnetic extraction and simulation analysis to ensure your system works under wide-ranging operating conditions.

      Overview Related Products A-Z

      製品カテゴリー
      • Electromagnetic Solutions
        • Tools
        • Clarity 3D Solver
        • Sigrity XcitePI Extraction
        • Sigrity XtractIM
        • Sigrity PoweSI
      • Thermal Solutions
        • Tools
        • Celsius Thermal Solver
      • Flows
    • FPGAプロトタイピング
    • PCB設計/解析
      PCB 設計/解析概要

      Cadence® PCB design solutions enable shorter, more predictable design cycles with greater integration of component design and system-level simulation for a constraint-driven flow.

      概要 Related Products A-Z Service Bureaus

      製品カテゴリー
      • 回路設計
        • Flows/Tools
        • Allegro Design Entry Capture/Capture CIS
        • Allegro Design Publisher
        • Allegro Design Authoring
        • Allegro FPGA System Planner
      • プリント基板レイアウト
        • Flows/Tools
        • Allegro PCB Designer
        • OrCAD PCB Designer(外部サイト)
      • ライブラリ/設計データ管理
        • Flows/Tools
        • Electrical CAD-Mechanical CAD Library Creator
        • Allegro EDM Solution
        • Allegro PCB Librarian
        • Allegro Pulse
      • アナログ/ミックスシグナル・シミュレーション
        • Flows/Tools
        • Allegro PSpice Simulator
        • OrCAD Pspice Designer(外部サイト)
      • PCB設計向けSI/PI解析ソリューション
        • Flows/Tools
        • Allegro Sigrity Serial Link Analysis Option
        • Allegro Sigrity SI Base
        • Allegro Sigrity PI Base
        • Allegro Sigrity Power-Aware SI Option
        • Allegro Sigrity PI Signoff and Optimization Option
      • SI/PI解析ツール
        • Flows/Tools
        • Sigrity PowerSI
        • Sigrity PowerDC
        • Sigrity OptimizePI
        • Sigrity System Explorer
        • Sigrity SystemSI
        • Sigrity Speed2000
        • Sigrity Broadband SPICE
        • Sigrity Transistor-to-Behavioral Model Conversion (T2B)
        • Sigrity PowerSI 3D EM Extraction Option
      • Allegro最新情報
        • Flows/Tools
        • Board Layout
        • Schematic Capture
        • Data Management
      • Sigrity最新情報
        • Flows/Tools
        • Sigrity 2018 Release
        • Sigrity Tech Tips
      • ソリューション/フロー
        • Flows/Tools
        • Multi-Board PCB System Design
        • システム製品開発ソリューション
        • 電気系CAD/機械系CAD 協調設計
        • Allegro Right First-Time Design
        • IO同時スイッチング解析ソリューション
        • 3D System Design Solutions
        • PDN設計ソリューション
        • LPDDR4 ソリューション
        • パワー考慮シグナル・インテグリティ解析ソリューション
        • インターフェース設計向けソリューション
        • Sigrityシリアル信号解析ソリューション
    • PERVASIVE INTELLIGENCE
    • テンシリカ DSP IP (USサイト)
    • 機械学習
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    • クラウド対応
    • 全製品(アルファベット順)
  • ソリューション
    • INDUSTRIES
    • 5Gシステム/サブシステム
    • 航空宇宙/防衛
    • オートモーティブ
    • TECHNOLOGIES
    • 3D-IC設計
    • Advanced Node
    • Armベース・ソリューション
    • クラウド対応
    • FPGA Development
    • Low Power
    • 機械学習
    • ミックスシグナル
    • フォトニクス
  • サービス
    • サービス 概要

      Helping you meet your broader business goals.

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    • トレーニング
    • メソドロジー・サービス
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    • サポート
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    • トレーニング・コース
    • Custom IC / Analog / RF Design
      Training Overview

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      Overview All Courses Asia Pacific EMEANorth America

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      • Circuit Design and Simulation
        • Featured Courses
        • Analog Design Environment - L
        • SKILL Language Programming Fundamentals
        • Spectre Simulations Using Virtuoso ADE
        • Design Checks and Asserts
        • Virtuoso Schematic Editor
        • Mixed-Signal Simulations Using Spectre AMS Designer
        • Spectre eXtensive Partitioning Simulator for Mixed-Signal Designs
        • Additional Courses
      • Infrastructure & Infrastructure v6
        • Featured Courses
        • Analog Design Environment - L
        • SKILL Development of Parameterized Cells
        • SKILL Language Programming Fundamentals
        • Virtuoso Schematic Editor
      • Layout Design and Verification
        • Featured Courses
        • Quantus QRC Transistor-Level Parasitic Extraction
        • Virtuoso Schematic Editor
        • Quantus QRC Extraction Series
        • Using Virtuoso Constraints Effectively
      • Modeling
        • Featured Courses
        • Analog Modeling with Verilog-A
        • Mixed Signal Simulations Using AMS Designer
        • Mixed-Signal IP and Testbench Reuse
        • Virtuoso ADE Explorer Series
      • Physical Design
        • Featured Courses
        • SKILL Language Programming Fundamentals
        • SKILL Development of Parameterized Cells
        • Virtuoso Layout Suite XL/GXL
        • Virtuoso Layout Suite-L
        • Virtuoso Schematic Editor
        • Virtuoso Schematic Editor (VSE) Interface Virtuoso Layout Suite Flow
        • Spectre Accelerated Parallel Simulator
      • Update
        • Featured Courses
        • Virtuoso Layout Suite XL/GXL
      • Variation Aware Design
        • Featured Courses
        • Analog Design Environment-XL/GXL
        • Spectre Simulations Using Virtuoso ADE
        • High-Performance Simulation Using Spectre Simulators
      • Delivery Methods
        • Instructor-Led Training

          Instructor-led training [ILT] are live classes that are offered in our state-of-the-art classrooms at our worldwide training centers, at your site, or as a Virtual classroom.

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        • Online Training

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    • Language and Methodology Courses for Chip and SPB Design
      Training Overview

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      Tools Categories
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      • SystemVerilog and UVM
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        • Verilog Language and Application
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        • Instructor-Led Training

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        • Online Training

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    • Digital IC Design
      Training Overview

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      • Formal Verification
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        • Voltus Power-Grid Analysis and Signoff
      • Delivery Methods
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      • Block and Hierarchical Implementation
      • Synthesis
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        • Genus Synthesis Solution with Stylus Common UI
        • Low-Power Synthesis Flow with Genus Stylus CommonUI
    • IC Package Design and Analysis
      Training Overview

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        • Allegro Package Designer
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        • Allegro Sigrity SI Foundations
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    • System Design and Verification
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        • Incisive Function Coverage
      • Simulation, Testbench and Debug
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        • Incisive Function Coverage
        • Indago Debug Analyzer App
        • Incisive Functional Safety Simulator
        • Incisive Simulation Performance Optimization
        • Low-Power Simulation with IEEE Std 1801 UPF
        • Xcelium Fault Simulator
        • Xcelium Integrated Coverage
      • Verilog and VHDL
        • Featured Courses
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        • Instructor-Led Training

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  • コミュニティ
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AI/機械学習ソリューション

より卓越した設計とAIシステムの実現に向けて

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未来に向けた革新的な製品の先行開発を支援

人工知能(AI)は人々の生活に大変革をもたらします。そしてその恩恵は、自動運転や医療診断などの進歩を加速し、すべての人にもたらされるでしょう。それはどのように実現されるのでしょうか。

畳み込みニューラルネットワークや再帰型ニューラルネットワーク、機械学習やディープ・ラーニングは、電子機器の変革を進展させ、ソフトウェアとIPの進化により新たなシリコン・ルネサンスの幕が開きます。今、電子業界は、大規模化する設計データやシミュレーションデータ、それにより増大する設計の複雑さや生産性向上に関する課題への対応に取り組んでいます。

ケイデンスは、お客様のニーズの変化に応えるために、進化する市場に向けた製品への投資、開発を継続していきます。

EDAツールと設計フローに関しては、ケイデンスの設計ツールにおいて機械学習、ディープ・ラーニング技術を利用し、ツールの性能と処理速度を向上するとともに、設計者の生産性を飛躍的に改善します。

また、IPについては、エッジ側でのAI処理を可能にするTensilica® DSPおよびプロセッサ、さらにメモリコントローラIPなど幅広い設計IPのポートフォリオがコンシューマ向けデバイスに対してAI機能を提供し、高性能なメモリ・インターフェースによりクラウド・コンピューティング、高性能コンピューティングにおける機械学習を可能にします。

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EDAツールおよび設計フローにおけるAI/機械学習の適用

Reduce evaluating time, leverage our libraries of algorithm

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AIシステムの実現

Enable compute and data-intensive machine learning/AI applications

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設計ツールおよびフローへの適用

ケイデンスは、すでに機械学習の技術をEDA技術に適用し、設計フローにおける様々なステップにおいてより優れた予測性の高い結果を得ています。しかし、改善が可能な分野はまだたくさんあります。機械学習により設計プロセスをさらにスマートなものにして手作業が介入する必要性を削減できれば、お客様の市場投入時期を加速することに役立てることができるはずです。ケイデンスの目標は、設計チームが数週間、数ヶ月かけて検討するような共通の問題を短時間で解決するためのソリューションをケイデンスのツール自体が提案できるようにすることです。

ケイデンスは、シミュレーション、検証、アナログ、パワー解析、配置・配線、モデリングなど各ツールをより優れたものにすると共に、様々な統計モデルと組み合わせて機械学習技術を適用しています。以下にいくつかの例をあげます。

Virtuoso® Layout Suite for Electrically Aware Design および Analog Design Environments – Virtuoso Electrically Aware Design Environmentはインデザインの高速寄生抽出において分析技術と機械学習技術を使っています。また、Virtuoso Analog Design Environmentでは、設計のチューニングと検証の不整合モデリングにおいて機械学習を使用しています。

JasperGold® Formal Verification Platform (Apps) – この次世代検証プラットフォームは、機械学習技術を活用してJasperGoldのアプリケーションの検証スループットを向上させています。

シリコンのサインオフ検証 – ケイデンスは Liberate™ Characterization Portfolio や Tempus™ Timing Signoff Solution. などのサインオフ検証製品ポートフォリオで機械学習技術を採用しています。

ケイデンスは、機械学習とディープ・ラーニング研究の最先端企業として、設計の改善を目標にIC設計と検証技術を向上させています。ケイデンスの機械学習チームは、アルゴリズムのライブラリを蓄積し、複数のプラットフォームや製品で共通に利用することで、機械学習による革新がEDAおよびIPソリューションに幅広く波及するよう努めています。

AIシステムの実現

多くのお客様が様々なAIアプリケーションを開発し、今までのエレクトロニクス業界では考えられないような大規模なデータへの対応が求められ、生産性、演算要件に新たな課題が課されています。例えば、複雑な演算を伴うアルゴリズムを標準的なプロセッサで実行していては、データ量や演算の多いAI/機械学習アプリケーションに求められるパフォーマンスや省電力性能を得ることができません。

ケイデンスは、サーバー向けのAIアプリケーションが必要とする高度なメモリ・インターフェース技術におけるリーダーです。ケイデンスは、パートナーのMicron社と共に世界初のDDR5 IPシリコン・プロトタイプのメモリ・サブシステムを開発しました。また、Samsung社との協業によって、GDDR6インターフェースを市場に投入してきました。ケイデンスは、モバイルアプリケーションや車載アプリケーションにおいてAIをサポートするために、業界初の7nmテクノロジで動作するLPDDR5を提供しました。

ケイデンスのTensilica DSPプロセッサは、エッジ側におけるAI処理に向けて最適化されています。バッテリー駆動のモバイル製品や熱の制約がある車載製品などエッジ側演算における要件を満たすためには、極めて消費電力効率の高いDSPが求められます。

エッジ側でのAI推論に特化して開発されたTensilica DNA 100プロセッサはTensilica AIファミリーに加わった新製品です。畳み込みニューラルネットワークと再帰型ニューラルネットワークの両方をサポートし、ビジョン、音声、レーダー、ライダー、通信など様々な分野の製品におけるAI実現をサポートします。

ビジョンおよびニューラルネットワーク処理向けのTensilica Vision DSPsはさまざまなコンシューマ製品向けに設計されています。画像/コンピュータ・ビジョン、HDR処理、物体検出や顔認識、ジェスチャー認識など様々なアプリケーションにおいて複雑なアルゴリズムを処理します。

また、Tensilica HiFi DSPsは、オーディオ処理、AI音声処理を必要とするコンシューマ市場の全ての分野、および高度な音声ユーザインタフェース機能を統合する市場において幅広く採用されています。 さらに、広範囲にわたるオーディオ・ソフトウェアをサポートする最大のパートナーエコシステムを展開しています。

IP製品の詳細情報はこちら

Driving Innovation and Collaboration

Our technology experts explain how

Learn how to go from TensorFlow to RTL in three months

CEO Lip-Bu Tan discusses the intersection of AI and big data

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Pulin Desai talks about the latest addition to the Vision DSP family, the Vision Q7 DSP for Vision and AI

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Introducing the Tensilica DNA 100 Processor IP for on-device AI

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Exploring AI/Machine Learning Implementations with Stratus HLS

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Cadence Selected for Machine Learning Contract by DARPA

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Our job is helping customers design sophisticated silicon, which is becoming more and more complex.

Lip-Bu Tan

Chief Executive Officer

We’ve been leading the industry in the development, deployment, and support of electronic design flows that use machine learning, analytics, and optimization technologies.

Anirudh Devgan

President

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Chief Executive Officer

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Cadence is a member of the Center of Advanced Electronics Through Machine Learning (CAEML)

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EDA Finds a Common Framework for AI

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AI Challenges for Nex-Gen EDA

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Semiconductor Engineering

Automotive, AI Drive Big Changes in Test

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